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In terms of the HDLC frame structure and the theory of cyclic redundancy check, the implementation of the modules, constructing and deconstructing HDLC protocol frame, producing and checking the CRC code, and adopting the FPGA new technology were discussed.
为了控制器与微波设备之间数据的可靠传输，根据HDLC协议的帧结构和循环冗余校验原理，提出了一种新型的基于并行机制的HDLC协议控制器，讨论采用FPGA新技术实现HDLC协议帧的构成、解析模块及其内部的CRC码生成、检验模块的方法。
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One of methods is to combine the decoding trellis of CRC and convolutional codes.
其中一种方式就是结合循环冗余检验码和回旋码的解码网格。
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cyclic redundancy check：循环冗余检验
CRC 循环冗余检验(Cyclic Redundancy Check)的缩略语. 它是一种差错检验技术,数据帧的接收方用一个二进制素因子(生成多项式)除以数据帧的内容计算出余数,并将所计算出的余数与发送方存储在数据帧中的检验码进行比较.
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CRC Cyclic Redundancy Check：循环冗余检验
CQI Channel Quality Indicator 信道质量指示 | CRC Cyclic Redundancy Check 循环冗余检验 | CRNC Controlling Radio Network Controller 控制的无线网络控制器
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cyclic redundancy check code：循环冗余检验码
cyclic queues | 循环排列 | cyclic redundancy check code | 循环冗余检验码 | cyclic redundancy check | 循环冗余码校验
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Cyclic Redundancy Check CRC：循环冗余检验
纠错码 error correcting code | 循环冗余检验 cyclic redundancy check; CRC | 奇偶校验 parity check