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Multiple trials is the basic concept of many parallel simulated annealing. It is to perform multiple trials at the same time to search acceptable solutions. The division simulated annealing with no communication and The clustering simulated annealing are two common types of parallel simulated annealing methods. The division simulated annealing with no communication makes each processor generate its own adjacent solution from its own current solution and compute the acceptance probability for a adjacent solution. Each of the processors searches solutions without communicating each other. Clustering simulated annealing makes each processor generate its own adjacent solution from a common current solution and compute the acceptance probability for each adjacent solution. Then, it decides which adjacent solution should be used to replace current solution according to a pre-specified rule.
许多平行模拟退火法之理论依据为多向试验，利用同一时间探索更多方向的试验来拓展搜寻的广度或深度，不进行沟通的分工模拟退火法(the division simulated annealing with no communication)以及丛集模拟退火法(the clustering simulated annealing)皆为平行化的模拟退火法，前者定义为各个处理器针对各自的起始解进行搜寻，产生各自的搜寻序列，在搜寻过程中处理器不进行任何沟通，各处理器仅针对自身之目前解进行搜寻；而后者定义为让所有处理器针对同一目前解进行运算搜寻各自的可能解，并各自决定其产出解之接受机率，最后根据事先决定之规则进行沟通比较，挑选其中一个可接受解取代目前解。
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Based on BAP array processor controller, we put forward a concept of embedded SIMD control core, which is the combination of RISC processor core used in multimedia and BAP array processor controller core. The embedded SIMD control chip can be flexibly customized using SIMD control core.
在BAP阵列处理器控制器的基础上，本文将针对多媒体应用的RISC处理器核与BAP阵列处理器控制器核进行结合，提出了一种嵌入式SIMD控制核的概念，利用SIMD控制核，可以灵活定制满足要求的嵌入式SIMD控制芯片。
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The 1MHz CPU might very well be faster, in practice, than the 2Mhz CPU - if it is more efficient or can process more tasks in each CPU cycle.
该处理器为1mhz很有可能更快，在实践中，比2mhz的中央处理器--如果这是更有效还是可以处理更多任务，在每个处理器周期。
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In recent years, with the increasing of the processor's frequency and the parallel degrees in processor's instruction executing, the processor's memory access operations expand greatly and bring great pressure to computer systems.
近年来，处理器内核的工作频率及处理器内部指令执行并行度的不断增加，使单位时间内处理器内核的访存频度不断增加，导致处理器对访存效率的要求也越来越高。
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In an asymmetric,shared-memory MP,processors are not equal.One processor is designed as the master processor,and the others are slave processors.
在非对称共享内存的多处理器中，各处理器地位不同，一个处理器设计成主处理器，其他则是从处理器。
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Each user is a Field-bus control node.SCM MCS-51 is used as its main processor,and Neuron CMOS as its assistant processor.The two processors cooperate with each other.the main processor sam pling and controlling,and the assistant processor taking chang of communication.
把整个系统作为一个LON网络，每个住户作为LON网络的一个现场控制节点并以MCS-51单片为主处理器，Neuron芯片为从处理器两处理器协同工作；主处理器采样控制，从处理器负责通信。
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The co-channel interference rejection filter for outputting a second input signal by removing co-channel interference from a first input signal; a first post processor for removing interference other than co-channel interference from the second input signal; a second post processor for removing interference other than co-channel interference from the first input signal; and a selection controller for selecting the output of the post processor which has less error by comparing the output of the first post processor with the output of the second post processor.
一种共道干扰消除器及其方法，其中抗共道干扰滤波器从第一输入信号中除去共道干扰并输出第二输入信号，第一后置处理器除去第二输入信号中的非共道干扰，第二后置处理器除去第一输入信号中的非共道干扰，选择控制器比较第一后置处理器和第二后置处理器的输出，从中选择误差较小的后置处理器输出。
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Uniprocessor designs have built-in bottlenecks.the address and data buses restrict data transfers to a one-at-a-time flow of traffic.the program counter forces instructions to be run in strict sequence.even if improvements in performance are achieved by means of faster processors and more instruction parallelism,operations are still run in strict sequence.however,in a uniprocessor,an increase in processor speed is not the total answer because other factors,such as the system bus and memory,come into play.
单处理器设计有内置的一些瓶颈。地址和数据总线限制数据传输的同时同地址的数据冲突情况。即使是通过更快的处理器和更多的并行指令，当然也包括维护，这些方式来提高的性能，程序的运行仍然被限制在严格的程式规则中。然而，在一个单处理器里，处理器速度的提高时不能完全解决这个问题的，这是因为像系统总线和存储器等其他因素同样在起作用。
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Coprocessors Another way to increase the performance of a computer is through the use of a coprocessor, which is a special processor chip or circuit board designed to assist the processor in performing specific tasks .
协处理器另一种提高计算机性能的方法是使用协处理器，它是一种专门设计的处理器芯片或电路板，用来辅助处理器执行特殊任务。
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But in a multiprocessors system,there may be several processors have read the same data,and then one processor will write it. This time,the copy of the data in the caches of other processors will be out of date.
但在多处理器系统中，由于多个处理器可能对同一数据块进行读操作，当某个处理器对共享的数据块进行写操作时，其它处理器的cache中该数据块的副本将成为过时的数据。
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array processor：阵列处理器
一种方案是采用标量处理器(Scalar Engine)和向量处理器(Vector Engine)或称阵列处理器(Array Processor)或者是CPU和DSP(数字信号处理器相结合的方法,设计全新结构的CPU.
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coprocessor：协处理器
参见位密度(bit density)颜色表 颜色表(color table)见颜色调色板(color palette)协处理器 协处理器(coprocessor) 辅助微处理器,通常用在系统中以分担主微处理器数字运算(数学协处理器)或视频功能,因此它可以全面地加速系统操作速度.
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preprocessor directive：前置处理器指示词 前置处理器指示词
preprocessing directive 前置处理器指示词 前置处理器指示词 | preprocessor directive 前置处理器指示词 前置处理器指示词 | preprocessor 前置处理器 前置处理器
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event handler：事件处理器
为了实现这个功能,需要使用一种称为事件处理器(event handler)的机制. 当事件发生时,事件处理器将连接到需要执行的事件处理代码. 事件处理器提供了当事件发生时捕获事件、并且执行相应的事件处理程序的机制.
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handler：处理器
这些阶段能被称为"处理器"(handler)的函数实现. 传统上, "处理器"是由C语言编写,并编译成Apache的模块. Mod_python提供了一个通过Python写的Apache处理器的来扩展Apache功能的方法. 关于Apache请求处理过程的详尽描述,
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exception handler：(异常处理器)
运行时系统向后搜寻调用堆栈,从错误发生的函数,一直到找到一个包括合适的异常处理器(exception handler)的函数. 一个异常处理器是否合适取决于抛出的异常是否和异常处理器处理的异常是同一种类型. 因而异常向后寻找整个调用堆栈,
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image processor：像处理器
二、图像处理器 二、图像处理器 新的图像处理器(Image Processor)可以转换与处理多个文件. 与批处理命令不同的是,使用图像处理器时不必创建动作. 使用图像处理器可以将一组文件在...
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image processor：图像处理器
新的图像处理器(Image Processor)可以转换与处理多个文件. 与批处理命令不同的是,使用图像处理器时不必创建动作. 使用图像处理器可以将一组文件在JPEG、PSD、TIFF格式之间进行转换,也可以将文件同时转换三种格式;可以使用同样的选项处理数码相机RAW文件;
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preprocessing directive：前置处理器指示词 前置处理器指示词
prefix 前缀 前缀 | preprocessing directive 前置处理器指示词 前置处理器指示词 | preprocessor directive 前置处理器指示词 前置处理器指示词
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preprocessor：预处理器
#include设施是C++预处理器(preprocessor)的一部分. 预处理器处理程序的源代码,在编译器之前运行. C++继承了C的非常精细的预处理器. 现在的C++程序以高度受限的方式使用预处理器.