HDLC
- HDLC的基本解释
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高级数据链路控制
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In terms of the HDLC frame structure and the theory of cyclic redundancy check, the implementation of the modules, constructing and deconstructing HDLC protocol frame, producing and checking the CRC code, and adopting the FPGA new technology were discussed.
为了控制器与微波设备之间数据的可靠传输，根据HDLC协议的帧结构和循环冗余校验原理，提出了一种新型的基于并行机制的HDLC协议控制器，讨论采用FPGA新技术实现HDLC协议帧的构成、解析模块及其内部的CRC码生成、检验模块的方法。
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The transmission apparatus for half duplex communication using HDLC includes: a clock generator, an HDLC controller, flag delay/detecter device, a control logic circuit and an output controller.
其包括时钟发生器、HDLC控制器、标记延迟／检测装置、CPU、控制逻辑电路和输出控制器。
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The system further includes an high-level data link control controller for transmitting and receiving a packet data to and from a subscriber wireless connection unit through an HDLC channel, a dynamic random access memory having a first buffer for storing a mobile image packet data transmitted between the HDLC controller and the LAN controller and a second buffer for storing a packet data other than the mobile image, and a CPU for performing the corresponding control function of a packet data routing unit.
系统进一步包括用于通过HDLC信道向/从用户无线连接单元发送/接收分组数据的高级数据链路控制控制器；具有用于存储在HDLC控制器和LAN控制器之间传输的运动图象分组数据的第一缓存器和用于存储运动图象分组数据之外的分组数据的第二缓存器的动态随机存取存储器；和用于执行分组数据路由单元的相应控制功能的CPU。
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High-level Data Link Control (HDLC)：高阶数据链结控制
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HDLC High-level data link control HDLC：协议
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