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timing simulation:时序模拟

使用新版本进行Verilog-HDL时序模拟(Timing Simulation)时,处理时间平均比老版本缩短60%,最高处理速度可达原来的18倍. VHDL的时序模拟速度平均缩短32%,最高处理速度提高到原来的3倍. 国际半导体设备暨材料协会(SEMI)预测,"全球经济复苏后,

single-acting engine:单动引擎

半金属迫紧 semi-metallic packing | 单动引擎 single acting engine | 单底 single bottom

SIP:abbr. semi-infinite-programming; 半无限规划

-1

skein yarn:落毛与棉混纺纱

skein yarn strength tester 绞纱强力试验机 | skein yarn 落毛与棉混纺纱 | skeleton semi-trailer 框架半拖车

Milk Skimmed:脱脂牛奶

Milk, pasteurised 巴氏灭菌法牛奶 | Milk, skimmed 脱脂牛奶 | Milk, semi-skimmed 奶,撇去奶皮的

sausage,skinless:无皮香肠

\\"半乾香肠\\",\\"sausage,semi-dry\\" | \\"无皮香肠\\",\\"sausage,skinless\\" | \\"夏日香肠\\",\\"sausage,summer\\"

sleeping car:卧铺车

9 硬座车 Hard seat coach;SEMI-CUSHIONED SEAT COACH | 10 卧铺车 Sleeping car | 11 软卧车 Cushioned berth sleeping car;UPHOLSTERED COUCHETTE

Small computer System Interface Device:系统接口设备

"Small Computer System Interface","系统接口" | "Small computer System Interface Device","系统接口设备" | "Semi-conductor Thermoplastic","热塑性半导体"

SET Small end Threaded:小端带螺纹

SEP Small end Plain 小端为平的 | SET Small end Threaded 小端带螺纹 | SF Semi-Finished 半光

coal soft:黑褐煤

半烟煤 coal semi-bituminous | 分粒煤 coal sized | 黑褐煤 coal soft

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